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A proposito di ZEN, di certo il passaggio dalla gravosa microarchitettura modulare CMT alla più snella e
performante SMT porterà ad un sensibile salto prestazionale delle cpu del colosso di Sunnyvale, potendo
senz'altro rimettere tutto in discussione :-)
A partire dalla seguente situazione in cui appare oramai certo che lo scheduler FP di ZEN si avvarrà di due
pipeline, entrambe con un vettore da 256bit (si è proceduto ad un incremento di ambiezza dai 128bit FMA
precedenti proprio per aumentare il throughput complessivo), se venissero però avvalorate in futuro le notizie
in mio possesso che indicano come ognuna delle due pipeline possa verosimilmente essere, invece, formata
dalla fusione di due singoli vettori da 128bit in una configurazione 2 x 128bit FADD + 2 x 128bit FMUL,
https://up.nexthardware.com/user_ima...-scheduler.jpg
mentre Haswell/Broadwell presenta già una conf pura da 2 x 256bit FMAC, allora sarebbe facile prevedere
le seguenti performance:
codice a 128bit FMA:
ZEN: 16 flop
Broadwell: 16 flop
codice a 256bit FMA:
ZEN: 16 flop
Broadwell: 32 flop
Se fosse davvero così, le future performance in virgola mobile di ZEN potrebbero essere (uso il condizionale
perché al momento non esistono certezze in tal senso) deficitarie già ora nei confronti delle attuali cpu Intel.
A tal proposito è utile ricordare come in Skylake-EP, Intel ha introdotto vettori da 512bit in previsione di un
futuro approccio AVX scalabile facilmente su vettori a 1024bit.
Sulle performance dell'integer scheduler non posso pronunciarmi, ma anche qui ho già le mie idee.
:-)
La tua opzione sarebbe una delle mosse più stupide da parte di AMD dal lancio di Bulldozer.
Non avrebbe senso mancare un futuro supporto all'AVX512, soprattutto considerando che tale modulo andrà dritto nei processori server, nelle APU server e nei nuovi SoC semi-custom per Apple.
non è assolutamente la mia opzione e non so nulla per certo, ma credo di essere in molto buona
compagnia :asd
https://patchwork.ozlabs.org/patch/524324/